无锡长期回收西门子厂家
数输阶段:依据令牌阶段的IN或OUT传输，来决定数输为DATA0或DATA1来进行数输握手阶段:接收信息的一方发送ACK信号以表示接收成功；若为N，表示发送失败；STALL表示不可预知的错误控制(Control)传输作用:USB传输过程支持的传输模式。USB主机为了获取设备描述符、ID、Product等信息，向USB设备发送相应的PID命令。特点:唯一可以进行IN/OUT传输的传输模式。
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默认管道（DefaultPipe）在设备一端来看就是端点0。主机此时发送的请求是默认地址0，端点0，虽然未分配地址的设备都是通过地址0来获取主机发来的请求，但由于枚举过程不是多个设备并行处理，而是一次枚举一个设备的方式进行，所以不会发生多个设备同时响应主机发来的请求。设备描述符的第8字节代表设备端点0的大包大小。虽然说设备所返回的设备描述符（DeviceDescriptor）长度只有18字节，但系统也不在乎，此时，描述符的长度信息对它来说是重要的，其他的瞄一眼就过了。当完成次的控制传输后，也就是完成控制传输的状态阶段，系统会要求hub对设备进行再一次的复位操作（USB规范里面可没这要求）。再次复位的目的是使设备进入一个确定的状态。
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以太网接口由MAC(以太网媒体接入控制器)和PHY(物理接口收发器)组成。以太网MAC由IEEE802.3以太网标准定义，实现数据链路层。常用的MAC支持10Mbit/s和100Mbit/s两种速率。吉比特网是以太网的下一代，速度将高达1000Mbit/s.PCI和PCI-EPCI是一种部总线，作为一种通用的总线接口标准，它目前在计算机系统中得到了广泛的应用。SD和SDIOSD是一种关于FLASH的储存卡的标准，也就是一般常见的SD记忆卡，在设计上与MMC保持兼容。SDIO在SD标准的基础上，定义了储存卡以外的外设接口。CPLD和FPGACPLD由可编程的与或门阵列以及宏单元构成。与CPLD不同，FPGA（现场可编程门阵列）基于LUT（查找表）工艺。CPLD和FPGA的主要厂商有Altera,Xilinx和Lattice等，它们专门的开发流程，在设计阶段使用HDL编程。它们可实现许多复杂功能，如实现USART，I2C等I/O控制芯片，通信算法，音视频解码算法等。甚至还可以直接集成ARM等CPU内核和外围电路。对于驱动工程师而言，我们就直接把它看成由很多逻辑门（与或非）组成的可完成一系列功能的芯片。如果完成的功能是CPU，我们就直接把它看成是CPU。
wIndex域:标识字串描述表的语言(LanguageID)，如果是其它语言的话就设为0。wLength域:表示要返回多少字节。如果描述表长度大于wLength域值，那么只有描述表的初始部分被返回。如果描述表比wLength域值小，则发送一个短包来标志传输的结束。一个短包被定义成一个长度短于大负载长度或一个空(NULL)包。这个标准请求包括3种描述符:设备(也就是设备的限定符)、配置(也就是其他速度配置)、及字符串。能进行高速操作的设备支持设备限定描述符返回有关设备不支持的速度信息(包括默认端点的wMaxPacketSize和其他速度配置的数量)。