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RAM可以分为:静态的RAM，也就是SRAM，和动态RAM，既DRAM。SRAM是数据被写上之后，就保持较为稳定的状态，因此不需要定期去刷新数据，一般CPU内部的高速缓存（cache）就是SRAM。而DRAM，是动态的，一般是以电荷的形式进行存储，也就是数据被存储在电容器，电容器因为漏电会导致电荷的流失，所以需要在定期地进行数据的刷新，我们常说的SDRAM、DDRSDRAM都是属于DRAM的范畴，一般将其理解为内存比较好理解。
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德州仪器（TI），美国件公司（ADI）是DSP的两大主厂商。其他处理器:为某种应用的特定设计。采用ASIC，CPLD/FPGA等实现。在实际项目的硬件方案中，往往会根据应用的需求方案选择通用处理器，数字处理器，特定领域处理器，CPLD/FPGA或ASIC之一的解决方案，在复杂系统中，这些芯片可同时存在，协同合作，各自发挥自己的长处。（ARM+DSP+FPGA）。存储器存储器主要可分为只读存储器（ROM），闪存（Flash）,随机存取存储器（RAM）。ROM在可细分为:不可编程ROM，可编程ROM，电可擦除可编程ROM（E2PROM），它可用软件来擦写。FLASH可分为NOR(或非)，NAND（与非）两种，Intel于1988年首先开发出Norflash技术，紧接着1989年，东芝发表了NANDflash结构，彻底改变了原先的EPROM，EEPROM的。
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可知，设备端驱动包含两部分:底层设备控制器驱动上层大容量存储类驱动设备控制器驱动USB设备控制器驱动主要实现GadgetAPI定义的函数和中断服务函数，可按功能划分为:API函数实现模块和中断处理模块。中断处理模块主要处理设备控制器产生的各种中断，包括端点中断、复位、挂起等中断。上图为设备端控制器基本架构，主要完成了Gadget驱动和控制器驱动绑定、注册。HCD:主机控制器驱动UDC:设备端控制器驱动OTG设备支持HNP和SRP协议。OTG设备通过USBOTG电缆连接到一起，其中接Mini-A接口的设备为A设备，默认为主机端，Mini-B接口的设备默认为B设备。当A、B设备完成数据交互之后，A、B设备之间的USBOTG电缆进入挂起状态:向A设备发起HNP请求。待A设备响应之后，A设备发送a_set_b_hnp_en，B设备响应之后即进入主机状态，同时发送请求使用A设备set_device，这样A、B设备完成主从交换。
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主机与设备之间的通信模型展示了USB主机和USB设备之间的数输过程。在设备端，USB设备将非USB格式的数据进行打包处理，转换成USB格式的数据包，然后传递到链路层，经过硬件处理、传递到物理层，由物理层通过PHY以数据流的形式传输到主机。USB主机在USB设备和USB主机之间发起的传输过程，稳为事务。每次事务以2到3个数据包的形式进行USB总线传输。每个数据包包含2到3个步骤:USB主机控制器向USB设备发出命令USB控制器和USB设备之间传递读写请求，其方向取决于部分的命令是读还是写USB主机控制器向USB设备发送事务类型请求，通过分组标识符来进行识别。主机和设备之间进行操作，通过分组标识(PID)来进行传输。数据包传输格式一般由:PID、数据/控制信息、CRC校验码组成。常见的PID主要包括令牌、数据、握手等类型组成。PID码以特定的方式组成，如下表所示: